重庆邮电大学光电工程学院微电子工程重点实验室
- 作品数：26 被引量：70H指数：4
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- 一种基于DAB的实时音频系统设计方案
- 2012年
- 通过对利用C++语言实现的实时音频采集编码系统进行介绍,该文提出了如何实现音频的实时采集和MP2音频编码。根据欧洲电信标准协会(ETSI)提出的ETS300799标准,提出了实时合成DAB传输帧的编码方案。实际测试结果表明,该系统能够完成音频数据的实时采集与发射工作,配套发射设备能组建一个实时性良好的实时音频采集编码系统。
- 王国裕曹瑞陆明莹
- 关键词：实时音频C++MP2
- 一种高性能DAB接收终端RF模块设计被引量：1
- 2011年
- 依据欧洲电信标准协会(ETSI)提出的ETSI EN 300 401标准,设计了一种高性能DAB接收终端RF接收模块的设计方法,实现了DAB信号稳定同步和接收,达到了高灵敏度和低功耗,在移动速度达到200 km/h时能够稳定接收。该设计方法已经用于批量生产的DAB接收终端中。
- 王国裕周珂张红升
- 关键词：高灵敏度低功耗
- 有限状态机的建模与优化设计被引量：20
- 2007年
- 通常的Verilog HDL编码风格生成的电路速度慢、面积大、毛刺干扰严重.基于此特点提出一种优秀、高效的Verilog HDL描述方式来进行有限状态机设计,介绍了有限状态机的建模原则,并通过一个可综合的实例,验证了该方法设计的有限状态机在面积和功耗上的优势.
- 陈勇
- 关键词：有限状态机VERILOGHDL仿真优化设计
- 基于PLI算法的AAC反量化和PNS解码模块设计
- 2012年
- 针对AAC(Advanced Audio Coding)解码器中具有复杂运算因而难以硬件实现的反量化模块和知觉噪音替代(Perceptual Noise Substitution,PNS)模块,提出用分段线性插值(Partition and Linear Interpolation,PLI)进行近似计算的方法.其基本原理是将复杂的曲线分割成多个区间,在每个区间内用线性插值的方法进行近似.利用该方法设计的反量化模块和PNS解码模块获得了较高的运算精度,最大运算误差率分别为2e-4和5e-3,全部运算可分解为简单的查表、乘法、加法和移位运算,易于硬件实现.FPGA验证结果表明,反量化模块仅耗用了45个逻辑单元和2 304ROM bits,PNS解码模块仅耗用了21个逻辑单元和144ROM bits,且解码音质良好,没有产生可感知的噪音.
- 张红升王国裕陆明莹蒋涛郭光宇
- 关键词：AAC反量化
- 基于智能手机的家居控制系统的设计被引量：1
- 2009年
- 随着智能手机的出现,其应用与开发也日趋广泛。基于智能手机的蓝牙模块实现住宅门禁识别、室内温度自动调节和灯具的智能控制,通过智能手机嵌入式软件完成程序功能。用户只需通过手机便可随时对系统进行控制,而且软件易于移植。
- 夏立连
- 关键词：智能手机蓝牙模块ARM7
- 基于数字多媒体广播的考场同步时钟设计被引量：2
- 2017年
- 基于数字多媒体广播(DMB)技术,设计了一款LED数字同步时钟。该时钟可实时接收DMB信号,解码出时间基准,并驱动LED点阵屏显示,所有时钟同步误差不超过1 s。除显示时间外,还可作为考场DMB接收机的信息显示终端,提供信号强度、告警等提示。与传统考场时钟相比,成本更低,同步性更好,更容易管理和维护,为现代化考场建设提供了新的信息化同步时钟解决方案。
- 张红升朱仁义王国裕潘超
- 关键词：数字多媒体广播同步时钟
- AAC解码中感知噪声替代算法的研究和实现
- 2013年
- 针对先进间频解码(advanced audio coding,AAC)中感知噪声替代(perceptual noise substitution,PNS)模块运算量大、不易硬件实现的问题,利用线性反馈移位产生伪随机序列模拟知觉噪声,并利用分段查表的方法对噪声进行整形,从而简化了PNS的解码算法。电路设计上,采用与AAC解码器复用RAM和运算模块的方法,以降低硬件资源消耗。设计结果表明,通过了现场可编程门阵列(field-programmable gate array,FPGA)验证并完成流片,芯片采用0.18μm CMOS工艺,PNS解码耗用1 528个逻辑门,整个AAC(含PNS)解码器功耗为8.5 mW,保持了原有设计低功耗的特点。
- 王国裕郭光宇陆明莹张红升蒋涛
- 关键词：FPGA验证芯片设计
- 低功耗高集成度MP3解码器IP核设计被引量：2
- 2013年
- 针对MP3解码器IP核低功耗和高集成度的要求,对MP3的解码算法和硬件结构进行优化,并设计定制处理单元高效率地执行解码运算,同时引入门控时钟实现MP3解码器的分时工作,从而以极低的硬件代价和功耗完成了MP3解码器IP核设计。该IP核采用16.384 MHz系统工作时钟,共耗用33 088个逻辑门和33 004字节存储单元,以0.18μm 1P4M CMOS工艺成功流片。芯片测试结果表明,该IP核具有正确的MP3解码功能,音质良好,最大解码功耗不超过9 mW,逻辑电路所占硅片面积仅为0.37 mm2。
- 张红升王国裕陆明莹
- 关键词：ASIC设计MP3解码器低功耗高集成度
- 室温合成的钙钛矿量子点及其电致发光二极管被引量：2
- 2021年
- 采用室温合成法制备出CsPbBr3钙钛矿量子点,并采用乙酸乙酯对量子点进行了一次、二次和三次清洗,以控制其表面配体密度。然后,利用合成并经过清洗的钙钛矿量子点制备了结构为ITO/PEDOT∶PSS/PTAA/CsPbBr3 QD/TPBi/LiF/Al的电致发光二极管(QLED)。研究了经不同清洗次数的量子点材料制备的器件的光电性能。结果表明,清洗2次的量子点在电荷注入与溶液稳定性之间得到平衡,利用其制备的钙钛矿QLED获得了最大亮度为1405cd/m^(2)、外量子效率为0.6%、色坐标为(0.127,0.559)的绿光发射。
- 王振卢永生陈家雯肖飞梁真山彭悦陈威威张文霞戚飞张楠张丽
- 关键词：钙钛矿量子点发光二极管
- 数字音频广播基带解码芯片的可测试性设计
- 2014年
- 介绍了一款数字音频广播基带解码芯片的可测试性设计,主要包括扫描测试(Scan Test)、存储器内建自测试(BIST)和电流测试。为了提高测试可靠性和芯片良品率,在扫描测试中,采用分级时钟树综合方法;在存储器测试中,采用分等级、分区域的RAM测试策略。为了降低设计复杂度,将所有测试结果都直接与芯片IO复用,并采用封装后再测试的方法,以降低测试成本。最终使用12条扫描链,扫描测试的覆盖率为96.2%。芯片量产后的测试结果表明,经过检测后的芯片在产品应用中全部工作正常,证明了可测试性设计的有效性。
- 张红升王国裕陆明莹
- 关键词：可测试性设计扫描测试内建自测试
