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安健

作品数：1 被引量：4H指数：1
供职机构：上海大学计算机工程与科学学院更多>>
发文基金：“上海－应用材料研究与发展”基金更多>>
相关领域：自动化与计算机技术更多>>

合作作者

文献类型

  • 1篇中文期刊文章

领域

  • 1篇自动化与计算...

主题

  • 1篇翻译器
  • 1篇VERILO...
  • 1篇VHDL

机构

  • 1篇上海大学

作者

  • 1篇吴悦
  • 1篇李俊红
  • 1篇杨洪斌
  • 1篇安健

传媒

  • 1篇计算机工程与...

年份

  • 1篇2005
共 1 条 记 录，以下是 1-1
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排序方式：
Verilog到VHDL翻译器的设计与实现被引量：4
2005年
描述了一个Verilog到VHDL翻译器Verilog2VHDL的设计与实现。首先将Verilog模块转换为中间格式,然后按照预定义的翻译规则,生成功能等价的VHDL设计实体。该翻译器目前只支持Verilog的一个子集。通过Verilog2VHDL,使得在Verilog-VHDL混合设计环境中重用Verilog设计成为可能。
安健吴悦杨洪斌李俊红
关键词：VERILOGVHDL翻译器
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