邓潇宇
- 作品数：2 被引量：0H指数：0
- 供职机构：南特大学更多>>
- 发文基金：广东省教育部产学研结合项目更多>>
- 相关领域：电子电信更多>>
- 数字前端功耗降低方法的仿真研究
- 2011年
- 数字前端是当前移动通信的研究热点,由于传送的信号是一种高频率,宽频带的动态信号,模拟前端信息处理方法不适合,且传统不均匀采样信号处理方法生成多个同频率不同相位的时钟信号,导致数字前端功率消耗较大。为了降低数字前端功率消耗,结合可编程逻辑器件(FPGA)的特有结构,设计了一种随机时钟产生模块,并利用所产生的随机时钟作为数字前端中模数转换器(ADC)的工作时钟频率,以产生不均匀采样ADC,从而有效地降低数字前端的功率消耗。仿真结果表明,所设计的FPGA模块能够产生随机性很好的时钟信号,且优于现有的设计方法,证明随机性越大的时钟信号能有效降低数字前端的功率消耗,为通信前端设计提供了依据。
- 邓潇宇戴青云J F Diouris钟润阳
- 关键词：可编程逻辑器件
- 基于随机采样的数字前端功率消耗问题的研究
- 随着大规模集成电路设计和制造技术的飞速发展,以Shannon均匀采样定理为基础的数字信号处理技术得到了飞速发展和广泛应用,但是,在具体的工程实践中,Shannon采样定理也显现出了它的局限性。本文主要探讨了非均匀采样的基...
- 邓潇宇
- 关键词：可编程逻辑器件数字前端数模转换器非均匀采样
- 文献传递
