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- 一种逻辑运算电路和超前进位加法器
- 本申请提供一种逻辑运算电路和超前进位加法器。其中逻辑运算电路包括:SET‑MOS非门,SET‑MOS非门包括:SET管;NMOS管,NMOS管的栅极和SET管的第一栅极接收第一输入电信号,NMOS管的漏极与SET管的漏极...
- 曲航祝天岳周海力唐萍郭佳铭赵海亮刘德州崔阳
- 忆阻器-CMOS逻辑模块及因式分解超前进位加法器
- 本发明属于加法器技术领域,具体涉及一种忆阻器‑CMOS逻辑模块及基于忆阻器‑CMOS逻辑模块的因式分解超前进位加法器。本发明提供的基于忆阻器‑CMOS逻辑模块的因式分解超前进位加法器包括三部分,第一部分产生进位传播和进位...
- 黄丽莲朱耿雷李文亚史旭刘帅
- 基于55nm工艺的超前进位加法器设计
- 随着半导体行业的技术封锁,高性能集成电路的自主设计对于保障国家安全、促进科技发展具有重要作用。而加法运算是数字电路中的基本运算之一,它在诸如算术运算、信号处理和通信系统等广泛应用中起到重要作用。其运算速度和电路功耗对整体...
- 周文宸
- 关键词:加法器电路设计
- 一种基于55nm工艺的超前进位加法器设计
- 2023年
- 加法器作为数字电路中的重要组件,其计算速度对系统性能至关重要。本文对加法器电路进行了深入研究,基于4进制Kogge-Stone树结构和多相时钟控制改进后的多米诺动态电路,设计了一种64位超前进位加法器,并完成全定制版图设计。该加法器采用55nm CMOS工艺,在3.7 GHz的时钟频率下,关键路径延时为372 ps,平均功耗为24.47 mW,功耗延时积为9.1 pJ,版图总面积约为29482μm2。这些结果显示,所提出的设计方案在性能方面取得了显著的改进。它不仅提高了加法器电路的计算速度,还有效降低了功耗和占用的芯片面积。
- 周冉冉周文宸王永
- 关键词:加法器
- 基于半导体光放大器的全光超前进位加法器
- 本实用新型公开了基于半导体光放大器的全光超前进位加法器,基于半导体光放大器的全光超前进位加法器,输入接口连接有第一SOA,第一SOA均与第一滤波器、第二滤波器连接,第二滤波器均与第二SOA、第三SOA连接,第二SOA连接...
- 刘尧韩丙辰杨潞霞王姣
- 超前进位加法器、安全加法器及执行超前进位加法的方法
- 本发明提供超前进位加法器、安全加法器及执行超前进位加法的方法。所述超前进位加法器包括:第一异或门接收第一遮罩值和第二遮罩值以提供一变数。第一遮罩单元根据变数对第一输入数据执行第一遮罩运算以得到第一已遮罩数据。半加法器接收...
- 吴坤益李钰珊
- 一种基于超前进位加法器实现的存算一体装置
- 本发明涉及一种基于超前进位加法器实现的存算一体装置,包括:2N个乘法模块、超前进位加法器和乘累加模块;利用乘法模块将输入数据与权重值相乘,并将相乘结果同时馈入超前进位加法器中进行累加,可实现灵活多位宽的全数字存内计算。另...
- 乔树山史万武尚德龙周玉梅
- 文献传递
- 一种基于单极型晶体管的四位树形超前进位加法器及芯片
- 本发明公开了一种基于单极型晶体管的四位树形超前进位加法器及芯片,其中加法器采用差分逻辑门构成,所述差分逻辑门由多个单极型氧化物薄膜晶体管组成,所述四位树形超前进位加法器的进位链路采用Koggle—Stone并行算法进行优...
- 陈荣盛刘坤荣陈德润徐煜明
- 混合基数超前进位加法器架构
- 本文所描述的实施例涉及混合基数超前进位加法器以及由其执行的方法。混合基数超前进位加法器包括多个超前进位级,其中每个级可以具有不同的基数。每个级在输入比特上操作,为每个比特创建并实现传播信号和生成信号。超前进位级还计算输入...
- N·T·乔瑟夫森S·B·斯豪克
- 文献传递
- 一种基于超前进位加法器实现的存算一体装置
- 本发明涉及一种基于超前进位加法器实现的存算一体装置,包括:2N个乘法模块、超前进位加法器和乘累加模块;利用乘法模块将输入数据与权重值相乘,并将相乘结果同时馈入超前进位加法器中进行累加,可实现灵活多位宽的全数字存内计算。另...
- 乔树山史万武尚德龙周玉梅
- 文献传递
相关作者
- 王成华

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- 供职机构:南京航空航天大学
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- 王礼平

- 作品数:21被引量:74H指数:5
- 供职机构:中南民族大学电子信息工程学院
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- 刘伟强

- 作品数:156被引量:32H指数:3
- 供职机构:南京航空航天大学
- 研究主题:电路 乘法器 逐次逼近型 乘法 流水线
- 王观凤

- 作品数:9被引量:29H指数:4
- 供职机构:中南民族大学电子信息工程学院
- 研究主题:超前进位加法器 电子设计自动化 优化设计 CLA HDPLD
- 何明华

- 作品数:159被引量:170H指数:6
- 供职机构:福州大学
- 研究主题:混合结构 混合电路 逻辑功能 平均功耗 电路功耗